Passe o mouse sobre um ponto ou selecione-o para explorar o espaço de trabalho.
Alterne entre execuções salvas e suas formas de onda, esquemas, resultados e relatórios.
Veja o gráfico de desempenho junto com sua interpretação e o artefato de origem.
Consulte métricas de desempenho, interpretação e artefatos de apoio em um relatório.
Compare resultados observados com requisitos e consulte a próxima ação de cada verificação.
Inspecione período de clock, tempo de chegada, frequência estimada e margem de recursos da execução atual.
Revise temporização, potência, área e evidências no painel de signoff.
Siga a hierarquia por blocos de módulos, portas e conexões roteadas.
Inspecione o módulo selecionado e escolha as camadas visíveis de dados, sinais, clock e rótulos.
Explore módulos RTL e suas conexões em uma hierarquia tridimensional.
Navegue por instâncias de módulos e seus arquivos sem perder a estrutura do projeto.
Consulte entradas, saídas e sinais internos ao lado do arquivo ativo.
Edite SystemVerilog com a hierarquia de módulos e o resumo de sinais ao lado do código.
Inspecione um módulo e siga suas conexões de entrada e saída pelo esquema.
Consulte portas, redes, categorias de sinais e vizinhos conectados da célula selecionada.
Acompanhe módulos, portas e redes no esquema hierárquico.
Análise incremental de grandes bases RTL e módulos com milhões de linhas em menos de 40 segundos
Compatibilidade completa com o padrão IEEE 1800-2017 SystemVerilog e as especificações formais Sail
Reduza ciclos de depuração com análise automática de DRC e CDC antes da síntese
Um projeto de referência de hardware de código aberto sintetizado e verificado com a cadeia de ferramentas da Altifigence.
Um servidor de linguagem nativo em C++/Rust indexa incrementalmente grandes bases RTL de projetos com milhões de portas em menos de 40 segundos. Ele diagnostica erros de sintaxe, múltiplos drivers, cruzamentos de domínios de clock (CDC) e problemas de conexão de sinais enquanto você programa.
Um ambiente CAD de hardware para captura de esquemas, roteamento diferencial de alta velocidade e verificação de folgas de montagem 3D em tempo real.
Analisa folga de temporização, profundidade lógica e restrições de área para explorar variantes de circuitos, bloqueando 100% das divergências funcionais por verificações formais.
Conecta agentes de IA externos ao mecanismo AST local pelo Model Context Protocol, com testes de regressão em sandboxes isolados na nuvem.
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Oferece suporte bidirecional completo a formatos padrão amplamente validados no setor de semicondutores, permitindo interoperabilidade fluida com cadeias EDA existentes.
Usa NVIDIA CUDA-X para acelerar pipelines computacionais complexos centrais ao projeto e à verificação, incluindo análise RTL em larga escala, indexação AST e simulação.
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